常规PLL电路原理图 , 摘自《CS8416 Datasheet》 , Cirrus Logic, Inc. AUGUST ’07.
通过仔细的设计和元器件的选择 , PLL可以实现很好的时钟跟踪的性能 , 并控制Jitter(时基抖动)在较小的水平 。但是 , PLL电路的性能容易受信号质量、传送线路质量、器材、干扰和速度等因素的影响 , 在高速的状态下性能受限制 。
ESS公司使用了异步采样率转换的技术 , 通过适当的计算 , 使DAC的时钟与音频信号时钟保持一致但与暂态变化脱离 , 芯片使用本地产生的时钟信号 , DAC的Jitter仅取决于本地晶振的固有性能 , 实质性地来消除信号中和传输中的Jitter , 降低对前端信号质量、连接线、器材等的要求 。ESS公司Sabre DAC的SPDIF接口能够达到很宽裕的Jitter容忍度 。
Sabre DAC的Jitter消除电路原理图 , 摘自《 About Jitter》AMM ESS, October 2011;
芯片不同时钟来源比较
2)HyperStream调制器
ESS公司的低阶级联的调制器 , 称为HyperStream调制器 , 使调制深度接近100% , 并且保持调制器稳定 , 从而降低Sigma-Delta DAC的暂态(频域)非线性和噪声 。
3)过采样率倍增器(OSR Doubler)
Sigma-Delta DAC都采用过采样技术来扩大动态范围 , 再通过噪声整形来降低音频频带内噪声 。早期的DAC芯片的过采样频率还在较低的水平 , 如4~16倍的标准音频采样频率 , 现在的芯片可以做到更高的频率 , 来进一步提高DAC的性能 。日本AKM公司 , 在数字滤波中采用过采样率倍增器(OSR Doubler) , 来增加输入信号的范围、降低音频带内噪声、同时降低功耗 , 其高端DAC芯片如AK4490等 , 过采样倍数可达到256倍 。
4)分段DAC
按所处的位置和所起作用的不同 , 分段数字信号高位和低位 , 再有目的地分别进行处理 , 可以提高DAC的性能 。Texas Instruments在PCM179x和DSD179x系列等芯片中采用了这项技术 , 称为“先进分段DAC” , 来增加动态范围和提高对Jitter的容忍度 。
Texas Instruments的“先进分段DAC”原理图 , 摘自《DSD1794A Datasheet》Texas Instruments, NOVEMBER 2006
5)其它技术
为了尽可能地改善音频DAC芯片的性能 , 厂商还会采取其它一些的技术 , 如:数据加权平均(DWA)、增益矫正和失真补偿、基准参考电压矫正、电流输出、低输出阻抗、差分互补输出、外部数字滤波、低噪声线性电源 , 等等 。技术手段是多样的 , 且有些技术还处于保密之中 , 因此也难以一一罗列和描述 。
4
高端音频DAC芯片排名
动态范围是音频DAC有代表性的性能参数 , 以下就按此性能高低并结合其它因素 , 对最高端部分的音频DAC芯片进行排名 。
高端音频DAC芯片排名:
注:动态范围数据为各厂商公布的各对应芯片的最大值 。排名未包括应用导向(如含有模拟放大器SoC)、独立调制器、独立数模转换器和停产的等芯片 。
ESS公司的ES9038PRO作为目前为止行业内参数指标最高的芯片之一 , 片上集成了SPDIF接口 , 通过采用采样率的异步转换技术的Jitter消除电路 , 与前端传输Jitter去耦合 , 有很大的Jitter容忍度 , HyperStream专利调制器能使Sigma-Delta调制器克服一些频域暂态的非常线性 , 外加其它的一些技术 , 如失真矫正、8通道可随意切换的差分DAC、专用的超低噪声线性电源(ES9311Q)等 , 作为性能最好的芯片 , 有许多的优势 。
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